English
全部
搜索
图片
视频
短视频
地图
资讯
更多
购物
航班
旅游
笔记本
报告不当内容
请选择下列任一选项。
无关
低俗内容
成人
儿童性侵犯
时长
全部
短(小于 5 分钟)
中(5-20 分钟)
长(大于 20 分钟)
日期
全部
过去 24 小时
过去一周
过去一个月
去年
清晰度
全部
低于 360p
360p 或更高
480p 或更高
720p 或更高
1080p 或更高
源
全部
Dailymotion
Vimeo
Metacafe
Hulu
VEVO
Myspace
MTV
CBS
Fox
CNN
MSN
价格
全部
免费
付费
清除筛选条件
安全搜索:
中等
严格
中等(默认)
关闭
筛选器
DSD Trunking Tutorial
已浏览 240.9万 次
2018年11月18日
hagensieker.com
【FPGA设计之DDS系列一】基于fpga的dds设计仿真,matlab生成
…
已浏览 1万 次
2021年12月14日
bilibili
FPGA设计圈
【小梅哥FPGA】DDS原理详解与实现
已浏览 5万 次
2020年11月3日
bilibili
小梅哥FPGA
Introduction to Digital Circuit Design with Verilog | Interview Preparatio
…
已浏览 6827 次
2021年6月1日
YouTube
PlanetSkillzz
24:32
Viva Questions of Digital system Design Lab KEC 352 | Viva questio
…
已浏览 3.6万 次
2022年3月5日
YouTube
Techno Tutorials ( e-Learning)
22:49
Behavioral Modeling | #13 | Verilog in English | VLSI Point
已浏览 4.8万 次
2021年10月15日
YouTube
VLSI POINT
3:52
【FPGA教程案例28~29】基于FPGA的DDS直接数字频率合成器
已浏览 12 次
4 个月之前
YouTube
fpga.matlab
33:48
FPGA数字信号处理(2)——查表法实现DDS信号发生器
已浏览 4255 次
2021年2月14日
zhihu.com
FPGA探索者
46:28
FPGA数字信号处理——Vivado DDS信号发生器(1)【FPGA】+【DDS
…
已浏览 2.7万 次
2021年2月14日
bilibili
FPGA探索者
3:36:13
数字系统设计DSD - 期末串讲(北邮国院)
已浏览 4001 次
11 个月之前
bilibili
阿淞73355
2:33
基于FPGA的直接数字频率合成器verilog实现,包含testbench
已浏览 414 次
2024年10月30日
bilibili
简简单单做算法
45:32
VERILOG LAB 1: OVERVIEW PART 1
已浏览 1411 次
2023年10月21日
YouTube
ĐTH
7:51
DSD - Introduction
已浏览 688 次
2020年2月18日
YouTube
Digital Systems and Communications
17:41
FPGA实验七:SystemVerilog直接数字频率合成器DDS
已浏览 533 次
7 个月之前
bilibili
limingnefu
24:48
基于Verilog HDL语言的DDS正弦波产生设计
已浏览 4614 次
2023年1月8日
bilibili
Beneficially
33:45
用MATLAB进行实时DSP系统的算法设计和原型生成 - 视频 - MATLAB
已浏览 5720 次
2018年4月23日
bilibili
op123258
14:07
DDS学习、实现与优化3_基本功能的verilog实现
已浏览 753 次
2022年8月20日
bilibili
帅比政
18:42
Writing 2by2-Multiplier Verilog HDL Code & Simulating on Xilinx: ISE
…
已浏览 1.5万 次
2020年6月29日
YouTube
Dr Kay
6:09
SDRuno VAC & DSDdecoder (MV008)
已浏览 4.4万 次
2017年5月4日
YouTube
SDRplay Software Defined Radio Receiver
30:42
VERILOG MODELING EXAMPLES
已浏览 8.9万 次
2017年8月22日
YouTube
Hardware Modeling Using Verilog
45:41
4.3.Verilog实现DDS信号发生器-Video_1
已浏览 5985 次
2021年6月14日
bilibili
该帐號已被封禁
10:37
Verilog VHDL Interview Questions Part 1
已浏览 5.8万 次
2020年9月6日
YouTube
Technical Bytes
2:09:32
基于FPGA的DDS原理详解与实现
已浏览 1.3万 次
2021年1月6日
bilibili
FPGA科普
12:12
DDS信号发生器试验-verilog ROM IP核
已浏览 2161 次
2022年5月17日
bilibili
javaisone
25:37
数字电路 Verilog 实验五:DDS 扫频信号发生器 FPGA 实现
已浏览 9061 次
2023年3月3日
bilibili
bnu_chenshuo
13:35
Digital System Design Using Verilog Module-1 Introduction and Method
…
已浏览 5283 次
2021年5月10日
YouTube
MS KHANDERAO
9:27
Verilog Tutorial: Introduction to Verilog
已浏览 15.6万 次
2017年8月14日
YouTube
Beginners Point Shruti Jain (Beginners Point)
11:55
VERILOG HDL :Data Flow Modelling Examples
已浏览 2.9万 次
2021年1月14日
YouTube
AA
2:42
Generating Verilog or VHDL From a Schematic
已浏览 7958 次
2021年5月22日
YouTube
Tea Leaves
9:44
Verilog Tutorial 10 -- Generate Blocks
已浏览 2.7万 次
2013年11月16日
YouTube
EDA Playground
观看更多视频
更多类似内容
反馈